华为正式发布韬（τ）定律，以 “时间缩微” 开辟芯片新路径，A 股半导体板块全线走强

发布时间：2026-06-01

一、发布背景与核心定义2026 年 5 月 25 日，华为公司董事、半导体业务部总裁何庭波，在上海举办的IEEE 国际电路与系统研讨会（ISCAS 2026） 上发表主旨演讲，并发布韬（τ）定律，这也是中国企业首次在全球半导体领域提出一套完整、可落地的产业演进新原则。过去 60 年，全球半导体产业遵循摩尔定律，核心逻辑为几何缩微：持续缩小晶体管物理尺寸，在单位面积内塞入更多晶体管，以此实

一、发布背景与核心定义

2026 年 5 月 25 日，华为公司董事、半导体业务部总裁何庭波，在上海举办的IEEE 国际电路与系统研讨会（ISCAS 2026） 上发表主旨演讲，并发布韬（τ）定律，这也是中国企业首次在全球半导体领域提出一套完整、可落地的产业演进新原则。
过去 60 年，全球半导体产业遵循摩尔定律，核心逻辑为几何缩微：持续缩小晶体管物理尺寸，在单位面积内塞入更多晶体管，以此实现性能提升、成本下降。但当前芯片制程进入 2nm、1.4nm 亚纳米阶段，量子隧穿、漏电流、散热、制造成本暴涨等物理与经济极限集中显现，单纯依靠缩小尺寸的发展路径已明显放缓、难以为继。
在此行业拐点下，韬定律（τ 定律） 提出全新发展范式：放弃单一 “空间尺寸缩小”，转向全栈 “时间缩微”，以电路时间常数 τ 为核心优化目标，通过架构创新、逻辑折叠、先进封装、软硬件协同等方式，压缩信号传输时延、提升单位时间计算效率，在同制程条件下实现芯片性能、晶体管密度、能效的跨越式提升。

二、核心技术：逻辑折叠与全栈优化

韬定律并非单一技术，而是覆盖器件、电路、芯片、系统的多层级协同优化体系，核心落地技术为逻辑折叠：
  1. 打破传统芯片二维平面布局，将平面电路进行立体堆叠、对称折叠，大幅缩短信号走线长度，降低 RC 延迟，在芯片面积不变的前提下，提升晶体管密度与运行速度；
  2. 配合全栈软硬芯协同设计，针对实际业务负载精细化调度指令流、数据流，进一步降低端到端执行时间；
  3. 技术路径摆脱对高端 EUV 光刻机、极致先进制程的强依赖，为受限环境下的芯片发展提供可行方案。

三、实战验证数据

何庭波在演讲中公布，韬定律相关技术已在华为内部完成长达 6 年、共计 381 款自研芯片的大规模实战验证。实测数据显示：同制程下，采用时间缩微 + 逻辑折叠方案，晶体管密度平均提升 53.5%，芯片能效提升 41%，综合性能达到甚至超越更高制程平铺设计芯片水平36氪。
同时华为透露，麒麟 2026 系列芯片将成为首款大规模商用逻辑折叠技术的旗舰产品，相关技术会逐步落地到 2027 年及后续量产芯片中；按照当前迭代速度预判，到 2031 年，基于韬定律优化的高端芯片，综合性能、晶体管密度可对标 1.4nm 传统制程芯片。

四、产业定位：并非取代摩尔定律，而是 “后摩尔时代” 补充新赛道

华为官方及行业解读均强调：韬定律不是推翻摩尔定律，而是摩尔定律进入瓶颈期后的并行演进路径36氪。
  • 摩尔定律依旧适用于仍有空间缩微的成熟制程与部分海外厂商；
  • 韬定律面向先进制程受限、物理极限逼近的行业现状，为全球半导体提供第二条发展主线；
  • 该技术体系坚持开放共享，华为表示未来将逐步开放相关标准、IP 核与参考设计，赋能全产业链，并非华为专属技术壁垒36氪。

五、市场反应：A 股半导体板块集体大涨

消息自 5 月 25 日发布后持续发酵，5 月 31 日 A 股半导体、芯片、集成电路板块全面走强，市场资金高度认可国产芯片新发展路径：
  • 科创 50 指数大幅上涨，多只半导体权重股放量走高；
  • 中芯国际、华虹公司、寒武纪、海光信息等上下游龙头个股全线拉升，近 60 只芯片概念股涨停或涨幅超 10%；
  • 券商机构纷纷上调半导体行业评级，认为韬定律将重塑全球芯片竞争格局，打开国产半导体中长期成长空间36氪。

六、行业影响与外界评价

  1. 行业层面：全球半导体产业正式进入 **“几何缩微” 与 “时间缩微” 双轨并行 ** 的新阶段，芯片竞争重心从单纯比拼制程节点，延伸至架构、封装、系统协同、软件优化等多维度；
  2. 国内层面：为国产芯片突破外部技术封锁、摆脱高端光刻机依赖提供核心方法论，加速国内半导体产业链自主可控进程；
  3. 国际舆论：海外科技机构、媒体持续跟踪解读，普遍认为这是后摩尔时代极具代表性的创新探索，同时也指出，该理论与技术仍需经过全球学术界独立复现、全产业链规模化落地两大阶段，才能真正成为全球通用产业规则36氪。
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